LPDDRおよびDDRメモリテスト

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DDR開発品の最初の起動からDDRコンプライアンス・テストまでの最速の旅

最初の電源投入から JEDEC 準拠テストまで、ダブル データ レート (DDR) および低消費電力 DDR (LPDDR) 設計のあらゆる段階を迅速にテストする適切なツールを使用して、最終製品への移行を加速します。

  • 最初の電源投入から検証までの DDR 製品開発を最大効率化
  • DDR プリコンプライアンス テストと詳細調整を加速
  • 包括的な DDR コンプライアンステスト

DDRテストは、最初の電源投入から検証までDDRの動作を最大化します。

適切なオシロスコープ ツールは、DDR および LPDDR の電気的検証、JEDEC 準拠テスト、および設計の複数の段階にわたるデバッグをサポートします。 テレダイン・レクロイは開発時間を短縮し、見落とされがちなエラーを発見するのに役立ちます。

専用ツールキット
WaveMaster 8000HD オシロスコープと Summit PCIe デバッグ用に CrossSync PHY インターポーザに接続された T516 アナライザ
Teledyne LeCroy DDR Virtual Probing のディエンベディング インターポーザーとプローブの位置のブロック図
ミッドバス反射と終端の問題を取り除いた後の Teledyne LeCroy DDR アイ ダイアグラム。
Teledyne LeCroy のオシロスコープは、ほとんどの DDR および LPDDR コマンド アドレス信号の DDR バス デコードとトリガを表示します。

基本動作の確立、信号のチェック、応答の検証は、開発ボードの初期起動時の基本となります。これは、信号が正しく見えるかどうか、信号が通信しているかどうか、コマンドバスが動作しているかどうか、電圧とタイミングの設定が適切な誤差の大きさであるかどうか、チャンネルがリードとライトの両方のパケットを示しているかどうかを知ることを意味します。これらの初期段階は非常に重要であり、メモリ設計のこの段階のためだけに作られたシンプルな専用ツールが必要となります。それにはコンプライアンステストではなく、それ以上の機能が必要となります。

  • DRAM (READ) またはコントローラー (WRITE) からの信号は正しく見えるか?
  • 初期電圧とタイミングの詳細は正しい場所にあるか?
  • コマンドバスは正しく通信してるか?

プローブやインタポーザが設計に与える影響を最小限に抑えることは、オシロスコープでDDR信号の品質を最大限に引き出すために非常に重要です。テレダイン・レクロイのDHシリーズプローブは、ソルダインチップとQuickLinkアダプタを備えた低ノイズ、低負荷のアクティブプローブです。インターポーザは、テストポイントをDRAMのボール近くに配置することで、信号品質をさらに向上させることができます。その後、プローブとインタポーザの組み合わせをバーチャル・プローブでデエンベッドすることができます。

    JEDEC では、DDR 測定を DRAM のボール(BGA)、つまり画像のテスト位置 1 で行うことを指定しています。プローブの位置が現在#2(インタポーザ)または#3(ミッドバスまたはVIA)である場合、DDR検証または測定を開始する前に、プローブの位置を仮想的に移動することができます。

    • インタポーザやライザーのあるT点を含んだ.2SP、.3SP、.6SPのSパラメータ・ファイルをデエンベッド
    • バーチャル・プロービングでは、プローブ・ポイントをメモリ・コントローラに移動し、歪んだREADパケットを解析可能
    • バス中間のプロービング位置に起因する問題を除去
    • 仮想プローブに関するブログ投稿チュートリアルを読む

    反射などのプロービングセットアップ誤差は、DDR設計品質と混同されることがあります。テレダイン・レクロイの Virtual Probe@Receiver を使用すると、反射を除去し、実際のDDR設計性能をより正確に把握することができます。

    • バーチャル・プローブ(VP@RCVR)によりレシーバ端での終端の問題を解決

    Teledyne LeCroy の HDA125 ロジック アナライザは、DDR コマンド アドレスをデジタルでプローブし、他の信号用のアナログ オシロスコープ チャネルを確保します。 DDR プロトコルのデコードとトリガーをこれらのデジタル プローブ信号に使用して、DDR アクティビティとデータ信号を分離してデバッグを高速化できます。 HDA125 ロジック アナライザーは、デコードおよびトリガー用に最高の 8400 MT/s DDR5 CMD アドレス ラインをサポートします。

    • 業界限定 DDR5 までのデコードとトリガー
    • JEDEC のコマンド真理値表をデコードする
    • より優れたR/W分離を実現し、コマンドバスはパケットの位置を認識します。
    • チャンネル上のオーバーレイ R/W ビジュアル

    DDRメモリテストの高速化 - 事前コンプライアンステストから微調整まで

    DDRおよびLPDDRメモリの動作安定性は、電圧、タイミング、パケットパラメータが設計において最大限に調整されたときに最適化されます。Teledyne LeCroyの DDRおよびLPDDRデバッグツールキット LPDDR および DDR の動作をより深く理解し、LPDDR および DDR メモリのテストを改善するのに役立ちます。

      DDRデバッグツールキットの機能と機能

      DDR デバッグ ツールキットは、複数の分析領域を使用してケースバイケースのテスト シナリオを構築し、コマンド バスでデコードとトリガーを実行し、JEDEC 固有のアイ ダイアグラム、マスク テスト、および DDR 固有の測定を使用して設計段階を最適化する機能をユーザーに提供します。

      Teledyne LeCroy DDR LPDDR ツールキットには複数のシナリオ ビューがあります

      複数シナリオの表示

      • 4 つのユニークなテストシナリオをレイアウト
      • 信号の前後の比較
      • ディエンベッド後とオリジナルを比較
      • READおよびWRITEストローブクロックを比較
      • 計測パラメータ値の比較
      Teledyne LeCroy DDR LPDDR アイ ダイアグラムとマスクがテストに合格

      アイ ダイアグラム、マスク テスト、JEDEC 固有の計測パラメータ

      • インタラクティブなユーザーツールキット
      • アイ ダイアグラムとマスク テスト
      • JEDEC またはカスタム マスク
      • マスクテスト抵触箇所の表示
      • LPDDRおよびDDR固有の測定
      Teledyne LeCroy DDR LPDDR は、コマンド アドレスを使用して最高の読み書きパケット分離を実現します

      最高の R/W 切り分け精度

      • コマンドアドレスをデコード
      • R&W の位置を正確に把握
      • 後付け可能な外部ロジック アナライザ
      • 最も低い容量負荷(競合他社の6分のXNUMX)

      JEDEC DDRコンプライアンスとデバッグのための包括的なDDRメモリテスト

      LPDDRおよびDDRコンプライアンステストは自動化されており、テスト時間の短縮とエラーの削減を実現します。共有テストセットアップを使用することで、DDRデバッグツールキットによる根本原因解析とコンプライアンステストを迅速に切り替えることができます。

      DDR コンプライアンス テストおよび DDR アイ ダイアグラム作成のための DRAM のボールでの JEDEC DDR メモリ テスト。

      JEDEC DDRコンプライアンステストの完全自動化カバレッジ

      コンプライアンス テストを迅速かつ効率的に実行し、結果を完全にレポートします。
      • 一貫したセットアップと再利用可能な構成でテストを自動化します
      • DRAMのボールで主要な電気的およびタイミングパラメータを検証し、アイダイアグラムを生成します。
      • 結果をHTMLまたはPDF形式でエクスポートして簡単に共有および分析できます
      • QPHY2-DDR5-SYS
      • QPHY2-LPDDR5
      • QPHY-DDR3 (DDR3/3L/LPDDR3)
      • QPHY-DDR4 (DDR4/LPDDR4/4X)
      DDR テストには、DDR コンプライアンス テストと DDR PHY デバッグが必要であり、セットアップの詳細は 2 つの異なる DDR テスト モード間で共有されます。

      コンプライアンステストからDDRデバッグツールキットのセットアップに素早く移行

      DDR デバッグ ツールキットは、DDR 設計サイクル全体にわたるテスト、デバッグ、および分析ツールを提供します。
      • DDRデバッグツールキット内で必要なすべてのDDRテストセットアップパラメータを設定します。
      • DDR信号忠実度を最大化するための最適化されたテスト設定を迅速に決定
      • DDRデバッグツールキットのテスト設定をQualiPHY 2コンプライアンステストオプションにコピーし、設定時間を節約します。
      QualiPHY 2アイコン

      QualiPHY 2 を使用すると、検証とコンプライアンスを短時間で実行できます。

      最も直感的で効率的なコンプライアンス テストと、生産性を向上するオフライン分析を実現します。
      • 簡素化されたテストインターフェース – 理解しやすく操作しやすい
      • ラボ内またはオフライン(ラボ外)のどこからでも時間どおりにコンプライアンスを実現
      • DDRデバッグツールキットからテストセットアップを共有する

      最新のテレダイン・レクロイ DDR テスト ソフトウェアをダウンロード

      MAUI オシロスコープ ソフトウェアおよび QualiPHY コンプライアンス テスト ソフトウェアのアップグレードに関する最新の DDR コンプライアンスおよびデバッグ テスト機能と機能を常に把握してください。

      DDR メモリ テストの更新と追加

      2025年5月

      • 最大速度5 MT/sのLPDDR5/8533X信号のサポートを追加

      2025年8月

      • QualiPHY 5フレームワークにLPDDR5およびLPDDR2Xコンプライアンステストのサポートを追加
      • DDR5コンプライアンステストがQualiPHY 2フレームワークでサポートされるようになりました

      その他の最近の更新と追加

      • QualiPHYコンプライアンステストソフトウェアにDDR5の測定項目を追加しました
      • QualiPHY DDR5 システムレベルコンプライアンステストを追加
      • LPDDR4Xのサポートとマスクテストを追加
      • LPDDR4XのQualiPHYコンプライアンステストを追加
      • 4レベル信号用のLPDDR4/XNUMXX読み取り/書き込みアルゴリズムを更新

        DDRテストに推奨されるDDRオシロスコープ、プローブ、ソフトウェア

        DDR テスト用のテレダイン・レクロイ製品およびインタポーザまたはテスト サービスのパートナーの詳細については、以下のタブとリンクをご参照ください。

        資料

        名称

        LPDDR5 データシート

        QualiPHY 2 (QPHY2-LPDDR5) データシートには、メモリ設計に関心のあるエンジニア向けに、テスト機能、注文情報などが概説されています。

        データシート

        DDR5 データシート

        DDR5 システム レベルの設計のすべての段階を (BGA で) テストします。 このデータシートは、QualiPHY 自動コンプライアンス テストを通じて早期にオンにするために作成されたツールの概要を示しています。 JEDEC が概説するデバッグおよびコンプライアンス スタイルの測定を実行します。 必要な機器と注文情報についてお読みください。

        データシート

        DDR4/LPDDR4/LPDDR4X データシート

        QualiPHY (QPHY-DDR4) データシートには、メモリ設計に関心のあるエンジニア向けのテスト機能、オーダー情報などの概要が記載されています。

        データシート

        DDR3/DDR3L/LPDDR3 データシート

        QualiPHY (QPHY-DDR3) データシートには、メモリ設計に関心のあるエンジニア向けのテスト機能、オーダー情報などの概要が記載されています。

        データシート

        DDR2 データシート

        QualiPHY (QPHY-DDR2) データシートには、メモリ設計に関心のあるエンジニア向けのテスト機能、オーダー情報などの概要が記載されています。

        データシート

        LPDDR2 データシート

        QualiPHY (QPHY-LPDDR2) データシートには、メモリ設計に関心のあるエンジニア向けのテスト機能、オーダー情報などの概要が記載されています。

        データシート

        DDR および LPDDR デバッグ ツールキット データシート

        LPDDRとDDRデバッグはDDR 2/の設計の全段階をサポート3/4/5 および LPDDR2/3/4/4X/5/5X で詳細なトラブルシューティングが可能になります。

        データシート
        DDR5 メモリのテストおよびREAD/WRITEバーストの切り分け
        LPDDR5-TOOLKITを使用したLPDDR5のテストとデバッグ
        LPDDR5 電気コンプライアンステストの概要 – QPHY2-LPDDR5
        DDRデバッグツールキットの設定をQualiPHY 2にコピーする方法

        DDRデバッグ、コンプライアンス、検証のためのDDRメモリ物理層テストの専門家になる

        テレダイン・レクロイのマスタークラス・ウェビナー・シリーズに参加して、一般的なテスト準備や課題、コンプライアンス・テスト・ツールとデバッグ・テスト・ツールの違い、DDR検証の効率を高め、適切なデバッグ・ツールを適用するための実践的なヒントやテクニックなど、オシロスコープを使用したDDRテストの基本について学びましょう。

        すべて登録

        このウェビナーでは、DDRインターフェースの包括的な概要と、テスト中に直面する課題について解説します。特に、検証テストとコンプライアンステストの要件の違い、そしてDDRメモリテストの準備に焦点を当てます。

        このウェビナーでは、DDR測定機能に影響を与える実際のプロービングおよび接続の問題への対処方法を具体的に解説します。対処すべきこと、すべきでないことの例を示し、コンプライアンステスト前のチェックリストを確認します。

        このウェビナーでは、デバッグツールを用いてDDRテストの課題を克服するための実践的なアドバイスを提供します。ロジック、はんだ付け、電源の問題といった実際のDDRデバッグ例、DDRのリード/ライト分離、アイパターン形成、クロックサイクルの欠落への対処など、幅広いトピックを扱います。さらに、DDRアイパターン、様々なシナリオにおけるジッタ、ハードウェアベースのリード/ライト分離、仮想プロービング技術についても解説します。

        このウェビナーでは、JEDEC DDR5 および LPDDR5 の仕様とテスト要件が以前のバージョンの DDR とどのように異なるか、また DDR5 および LPDDR5 メモリ テストを最適化する方法について詳しく説明します。

        名称

        DDR4/LPDDR4/LPDDR4X 取扱説明書

        QualiPHY(QPHY-DDR4)取扱説明書では、DDR4、LPDDR4、LPDDR4X DRAM規格の操作およびテスト方法をステップごとに説明しています。

        製品マニュアル

        DDR3/DDR3L/LPDDR3 取扱説明書

        QualiPHY (QPHY-DDR3) 取扱説明書では、DDR3、DDR3L、LPDDR3 DRAM 規格の操作およびテスト方法を段階的に説明しています。

        製品マニュアル

        DDR & LPDDR デバッグツールキット取扱説明書

        DDRデバッグはすべてのDDR 2/3/4/5とLPDDR2/3/4/4X/5をサポートし、困難な問題のトラブルシューティングを可能にします。このマニュアルは、ツールを最大限に活用するためのものです。

        製品マニュアル

        DDR2取扱説明書

        QualiPHY (QPHY-DDR2) 取扱説明書では、DDR2 DRAM 規格の操作およびテスト方法をステップごとに説明しています。

        製品マニュアル

        LPDDR2取扱説明書

        QualiPHY (QPHY-LPDDR2) 取扱説明書では、LPDDR2 DRAM 規格の操作およびテスト方法をステップごとに説明しています。

        製品マニュアル

        QPHY2-DDR5-SYS 取扱説明書

        QualiPHY 2 (QPHY2-DDR5-SYS) 取扱説明書では、DDR5 規格の操作方法とテスト方法を段階的に説明しています。

        製品マニュアル

        QPHY2-LPDDR5 取扱説明書

        QualiPHY 2 (QPHY2-LPDDR5) 取扱説明書では、LPDDR5 規格の操作方法とテスト方法を段階的に説明しています。

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